EDGE手机基带处理设计几种实现方法评估

　　在无线市场上，EDGE协议已迅速为业者所接受，EDGE手机设计中支持多时隙传输、多种调制解调器/语音编译码器是基带处理面临的最大挑战。如何以高性能价格比方式实现EDGE的基带部分并占据最小的PCB面积最小？目前有几种实现方法，本文将对这些方法的技术优缺点和风险进行评估，中国手机设计工程师和手机芯片设计工程师应予以关注。

　　EDGE通常称为2.5G的规范，并且被人们看作向3G系统过渡的标准，诸如宽带码分多址(W-CDMA)。通过实现EDGE协议，目前北美的时分多址(TDMA)移动通信系统和全球通(GSM)系统的开发者可以设计具有384Kbps数据率的手机。这使得一个小小的手机同时满足话音通信、因特网接入以及多媒体内容的要求成为可能。开发EDGE基带手机的工程师们将会面对一系列设计上的挑战。具体来说，在开发EDGE无线手机的基带部分时，工程师要遇到很多难点和新的设计方法问题。

目前的解决方案

　　为了详细地评估EDGE无线手机设计的基带结构，首先研究一下当前TDMA手机设计采用的基带结构至关重要。图1中标明的TDMA基带部分可以分成七大块。第一块包括射频(RF)到基带的接口。从基站到移动台间的下行传输链路中，RF信号以最小奈奎斯特速率进行数字化。在上行链路中，处理过程则相反，来自数字信号处理器(DSP)的数字化取样信号被转化为模拟信号。

　　第二块包括配备ROM、RAM的DSP芯片，以及协处理器。在这些组件中，DSP是基带模块的核心，它执行多种与协议物理层对应的计算强度要求高的功能

　　为突出该DSP的重要性，在处理一个对MIPS要求高的数字信道(DTC)时，应该对该组件的主要任务进行检测。在TDMA设计中，处理一个DTC接收时隙过程中，DSP首先进行“粗同步”，以寻找该时隙中的SYNC字。这样做是为了建立粗略的时间基准、频率误差和自动增益控制(AGC)的设置。接着处理器执行“精确同步”，建立均衡器的定时标志和初始信道系数。如果该信道传输有很大延迟，则采用一个微分检波器或均衡器对P/4微积分相移键控(DQPSK)信号进行解调。

　　该DSP接着将进行数字确认色标编码(DVCC)以及低速访问控制信道(SACCH)的序列解码。DVCC是一个确认收到正确的基站信号的参数。SACCH是在同一个时隙内作为话音信号或快速访问控制信道(FACCH)发送的低速控制信息。然后，进行话音/FACCH分离和解码。这些功能与传输端完成的交织和信道编码相对应，表现为时间分散性和误码率(BER)。