如何优化DSP功率预算

因此，下图提供了将内核电轨标示为 CVDD 的多核 DSP 加以说明。

一个额定电流为 15A 的 500KHz 降压转换器负责为 CVDD 供电。该设计可使用连接至 VID 编程器的 4 线数字接口实现 VID 控制，其可直接连接至任何模拟功率级或控制器。点击这里观看 VID 编程器的视频演示。

KeyStone DSP 与 VID 功能同步降压转换器的原理图

LM10011 与模拟 PWM 功率级

LM10011 不仅可采集出现在 DSP VCNTL 接口上的 VID 信息，而且还可设置连接至功率级电路反馈 (FB) 引脚的电流 DAC 输出。在 6 位模式下，既提供支持 940nA 分辨率的 64 种电流设置，又提供优于 1% 的误差精度。在本例中，CVDD 由 DSP 判定为一个电压介于 0.9V 至 1.1V 之间的电平，支持 6.4mV 的步进分辨率。无需电平转换器或胶合逻辑，电阻器 RSET可决定启动时的 CVDD 电压。LM10011 可与任何具有 FB 输入的电压、电流或 DCAP 模式 PWM 调节器连接。